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 曙海--工程師的項目導(dǎo)師。

曙海講師體系和課程體系歷經(jīng)多年升級,形成了以項目實戰(zhàn)經(jīng)驗豐富的工程師為基礎(chǔ),產(chǎn)學(xué)研相結(jié)合的體系,曙海的學(xué)員大部分來自外資企業(yè)、上市公司的,研究所的工程師或高校老師,很多學(xué)員都參加工作很多年了,這對曙海的講師形成很高的要求,曙海的講師隊伍名校博士、碩士學(xué)歷的工程師占絕大多數(shù),他們大部分為上海貝爾,TI德州儀器,華為,中科院,中興,Xilinx,Intel英特爾,NI公司,Cadence公司,Synopsys,IBM,Altera,Oracle,synopsys,微軟,飛思卡爾等大型公司高級工程師,項目經(jīng)理,技術(shù)支持專家,他們有著深厚的專業(yè)技能和技術(shù)素養(yǎng),豐富的項目實戰(zhàn)經(jīng)驗,基本上都有十多年實際項目經(jīng)驗,開發(fā)過多個大型項目。

 針對客戶實際需求,案例教學(xué),邊講邊練,互動式授課,曙海的專家講師以專業(yè)、敬業(yè)的精神,傾囊相授,不辜負(fù)每個學(xué)員的托付和期望。

良心教育--用良心做培訓(xùn),以技術(shù)贏得客戶尊重!

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曙海--IT高端培訓(xùn)的良心技術(shù)服務(wù)機構(gòu),一站式軟硬件技術(shù)服務(wù)平臺。

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以項目實戰(zhàn)為導(dǎo)向,以實戰(zhàn)演練貫穿始終,練習(xí)!練習(xí)!直到把技術(shù)練習(xí)到血液中!

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  Virtuoso UltraSim Full-chip Simulator vMMSIM培訓(xùn)
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識:
        ◆ 電路系統(tǒng)的基本概念。

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       堅持小班授課,為保證培訓(xùn)效果,增加互動環(huán)節(jié),每期人數(shù)限3到5人。
   上課時間和地點
上課地點:【上!浚和瑵(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班)
Virtuoso UltraSim Full-chip Simulator vMMSIM培訓(xùn):2025年4月7日........................(歡迎您垂詢,視教育質(zhì)量為生命!)
   實驗設(shè)備
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        專注高端培訓(xùn)17年,曙海提供的課程得到本行業(yè)的廣泛認(rèn)可,學(xué)員的能力
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       ◆在讀學(xué)生憑學(xué)生證,可優(yōu)惠500元。
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        1、培訓(xùn)過程中,如有部分內(nèi)容理解不透或消化不好,可免費在以后培訓(xùn)班中重聽;
        2、課程完成后,授課老師留給學(xué)員手機和Email,保障培訓(xùn)效果,免費提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。

  Virtuoso UltraSim Full-chip Simulator vMMSIM培訓(xùn)

Course Description

In this course, you run FastSPICE simulation on large, complex, mixed-signal designs using the Virtuoso? UltraSim Full-chip Simulator. You explore the capabilities, methods, and modes of the simulator. You apply a variety of configurations that exploit the simulator's commands and options. You gain experience with hierarchical simulations, simulations of individual blocks, aged simulations, and EMIR analysis.

Learning Objectives

After completing this course, you will be able to:

  • Simulate complex mixed-signal circuits quickly, using the FastSPICE simulator and Virtuoso UltraSim Full-chip Simulator
  • Adjust the simulator's option settings to produce the proper tradeoff between accuracy and speed
  • Construct probes and measures for reporting circuit performance during simulation
  • Examine postprocessing measurement
  • Verify the circuit performance and identify the potential failure modes by running advanced analysis, including static and dynamic checks
  • Run hierarchical top-level simulations for prelayout, combining transistor-level schematics with structural Verilog? HDL, behavioral Verilog-A models, or behavioral Verilog HDL models, digital stimulus (.vec, .vcd) files and postlayout simulation with adjustable parasitic reduction
  • Analyze the potential IR drop and electromigration (EM) problems in the layout by using Power IR/EM option and netlist-based EMIR
  • Effectively use the integration of FastSPICE simulation in the Analog Design Environment to improve silicon accuracy and time-to-market

 

 
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.(2014年7月11).......................................................................................
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