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曙海--工程師的項目導師。

曙海講師體系和課程體系歷經多年升級，形成了以項目實戰(zhàn)經驗豐富的工程師為基礎，產學研相結合的體系，曙海的學員大部分來自外資企業(yè)、上市公司的，研究所的工程師或高校老師，很多學員都參加工作很多年了，這對曙海的講師形成很高的要求，曙海的講師隊伍名校博士、碩士學歷的工程師占絕大多數，他們大部分為上海貝爾，TI德州儀器，華為，中科院，中興，Xilinx,Intel英特爾,NI公司，Cadence公司,Synopsys，IBM，Altera，Oracle，synopsys，微軟，飛思卡爾等大型公司高級工程師，項目經理，技術支持專家，他們有著深厚的專業(yè)技能和技術素養(yǎng)，豐富的項目實戰(zhàn)經驗，基本上都有十多年實際項目經驗，開發(fā)過多個大型項目。

針對客戶實際需求，案例教學，邊講邊練，互動式授課，曙海的專家講師以專業(yè)、敬業(yè)的精神，傾囊相授，不辜負每個學員的托付和期望。

良心教育--用良心做培訓，以技術贏得客戶尊重！

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曙海--IT高端培訓的良心技術服務機構，一站式軟硬件技術服務平臺。

包教包會，免費重修！全國連鎖，線上、線下培訓，公開課，上門內訓，技術咨詢，承接項目，專家外包。特殊技術訂制培訓&咨詢，按實際需求服務，課程不受時間限制（工作日、周末、晚班），充足的專家資源（每門課對應多名專家），精確匹配服務，不受地點限制--全國連鎖。小班教學，豐富專家資源，顧問式咨詢服務。

以項目實戰(zhàn)為導向，以實戰(zhàn)演練貫穿始終，練習！練習！直到把技術練習到血液中！

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　　　Signal Integrity for High-Speed Memory and Processor I/O

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堅持小班授課，為保證培訓效果，增加互動環(huán)節(jié)，每期人數限3到5人。

上課時間和地點

上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班）：Signal Integrity for High-Speed Memory and Processor I/O：2025年4月7日........................(歡迎您垂詢，視教育質量為生命！)

實驗設備

　    ☆資深工程師授課


        ☆注重質量
        ☆邊講邊練
        ☆合格學員免費推薦工作



        專注高端培訓17年，曙海提供的課程得到本行業(yè)的廣泛認可，學員的能力
        得到大家的認同，受到用人單位的廣泛贊譽。

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新優(yōu)惠

◆在讀學生憑學生證，可優(yōu)惠500元。

質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、課程完成后,授課老師留給學員手機和Email,保障培訓效果,免費提供半年的技術支持。
        3、培訓合格學員可享受免費推薦就業(yè)機會。

　　Signal Integrity for High-Speed Memory and Processor I/O

課程介紹

了解信號完整性技術以及如何應用于 Xilinx FPGA 和半導體存儲器間的高速接口。本課程將講述高速總線和時鐘設計，包括傳輸線終端、負載及抖動。您將采用CAD 工具包實現(xiàn)IBIS 模型仿真。本課程還包括管理PCB 和片上終端相關內容。

必備條件

?? 好具有 Xilinx FPGA 設計經驗(或學過 FPGA 設計原理課程)

課程概要

        ?? 信號完整性問題的領域界定
        ?? IBIS 模型
        ?? 使用合適的傳輸線終端
        ?? 了解負載對信號傳播的影響
        ?? 減小抖動的影響
        ?? 管理存儲器高速數據總線
        ?? 了解選擇 PCB 封裝效應
        ?? 片上終端和分立終端的區(qū)別

實驗介紹

        Mentor 實驗

        實驗1．選擇合適的Mentor 仿真器
        實驗2．信號完整性動手實驗，觀察反射和傳播效應
        實驗3．使用IBIS 仿真器，研究基本的傳輸線效應
        實驗4．使用存儲的仿真信息進行功率計算并進行附加的時鐘仿真
        實驗5．觀察傳輸線的耦合效應
        實驗6．演示如何使用EBD 模型處理SDRAM 模塊

        Cadence 實驗

        實驗1．選擇合適的Cadence 仿真器
        實驗2．分析一個簡單的時鐘網絡
        實驗3．多點時鐘網絡引起的信號完整性效應
        實驗4．交調分析
        實驗5．地址和數據分析

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